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공학,기술계열

[디지털 시스템 설계 및 실험] Latch, Flip-Flop, Shift Register

[디지털 시스템 설계 및 실험] La.hwp

등록인leewk2547

등록/수정일13.07.30 / 13.07.30

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보고서 설명

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3. (Master?slave pulse-triggered) D flip-flop (with reset)
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본문일부 및 목차

(Master&slave pulse-triggered) D flip-flop (with reset)

코딩

module dppr(D,C,R,Q,Q_);
input D,C,R;
output Q,Q_;
wire Q1,Q1_;

dl dl1 (AD,NC,Q1,Q1_);
dl dl2 (Q1,C,Q,Q_);

wire NR;
wire AD;
not (NR,R);
not (NC,C);
and (AD,D,NR);

endmodule

시뮬레이션

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